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Categories Xilinx Virtex FPGA Karten XV2DDR C1030-1302

XV2DDR C1030-1302

Das XV2DDR Steckmodul ist eine Komplettlösung, die die Entwicklungszeit für FPGA-basierte Endprodukte drastisch verkürzt. Es bietet einen kosteneffektiven, schnellen und einfachen Weg zur Integration von 1Mio FPGA Gattern und 32 MByte DDR SDRAM in eigene Produkte. Die Abmessungen von nur 64 x 55 mm ermöglichen einen kompakten Aufbau des Gesamtsystems. Die Verbindung zwischen Trägerboard und XV2DDR Modul wird über zwei 140 polige Miniatur-Steckverbinder hergestellt. Um das Virtex-II FPGA zu konfigurieren, kann wahlweise eine JTAG Verbindung, das herausgeführte SelectMap Interface oder der integrierte Flash Speicher benutzt werden.

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995,00 €

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Weitere Produktinformationen

FPGA Baustein	Xilinx Virtex-II™ XC2V1000-5FGG456C
unterstützte Betriebssysteme	nicht zutreffend
Benutzer I/O	219 FPGA I/O balls verbnden mit zwei 140-pin Steckvebindern (SMD, 0.8mm Raster)
Host Schnittstelle	JTAG
Speicher	Double Data Rate (DDR) SDRAM : Micron MT46V16M16-75 * Kapazität 256Mb (32 Mbyte) * Organisation 16M x 16 * Vier Bänke, 2.5V, SSTL_2 * Zykluszeit 7.5 ns (133MHz) In-System Programmable Configuration PROM * selbsttätige FPGA Konfiguration * 20,000 Programm/Lösch Zyklen * IEEE Std 1149.1 boundary-scan (JTAG) Unterstützung
Abmessungen	64 x 55 mm
enthaltenes Zubehör	Benutzerhandbuch auf CD-ROM
Download	Data sheet: XV2DDR Data sheet: DDR-SDRAM Controller Layout example of XV2DDR module connector Protel DXP Library for XV2DDR Modul provided by Bahne Carstens (bahne@articulograph.de) Image: Clipboard 1 Image: Clipboard 2
Schaltplan	im Lieferumfang enthalten
Sonstiges	DDR SDRAM controller: Die Firma array-electronics bietet für das XV2DDR Modul unter http://www.array-electronics.de einen DDR RAM-Controller mit Multi-Port Interface für anspruchsvolle Memory Konzepte mit mehreren Datenströmen an. Der DDR SDRAM Core stellt dem Designer eine konfigurierbare Anzahl von unabhängigen Datenports zur Verfügung, so dass die Implementierung von Memory Systemen mit mehreren unabhängigen Datenströmen deutlich vereinfacht wird. Für die anwendungsabhängige Priorisierung muss der Anwender lediglich eine kombinatorische Zugriffslogik entwerfen und testen. Ein kostenloser DDR RAM-Controller kann unter http://www.opencores.org/projects/ddr_sdr abgerufen werden. Diese 'Light'-Version erreicht 130 Mbytes/s bei 100MHz System-Clock, obwohl sie nur mit 2er Burst arbeitet und benötigt ca. 180 Slices im Virtex II. Dieser Core läuft auf dem XV2DDR Modul problemlos mit 133 MHZ !